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How to enter debug mode via trigger

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根据规范，通过trigger进入debug模式需要设置tdata1.action&tdata1.dmode=1，但dmode又仅在debug模式下可写。那么该如何在m模式下触发trigger进入debug模式呢？ [TRANSLATION] According to the specification, entering debug mode via trigger requires setting tdata1.action&tdata1.dmode=1, but dmode is only writable in debug mode. So how do you trigger the trigger to...

Question about the continuous LR instruction covering problem

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香山南湖dcache设计中，atomicReplayunit处理lr指令，当对应的地址块进行lr指令处理时，会锁住该地址块，在规定时间内接收该地址块对应的sc指令，lrsc匹配成功。但该模块在锁定时间内接收到新的lr指令，不会马上进行处理，而是等到锁定时间超时后才能处理该lr指令。在锁定时间内接收lr指令后，就无法处理新的原子指令 。 疑问：为什么不能在接受到第二次lr指令后就马上处理，并覆盖掉第一个lr指令，而是要等待超时后进行处理？ [TRANSLATION] In the design of dcache of Xiangshan South Lake, atomicReplayunit processes lr instructions. When the corresponding address block is processed by lr instructions, it will lock...

Is a Store Operation permitted between lr and sc?

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**Is your feature request related to a problem? Please describe.** 香山南湖dcache对应地址块在接受到lr指令后，对该地址进行store操作，再进行sc指令操作会匹配成功，不会返回错误。 疑问：1 单核的lr指令过后，store指令只在storebuffer上操作 ，无法立即写入 dcache，此原子操作功能是否有问题？ 2 即使store指令能在lr锁定时间进入dcache，但目前没有看到内部代码对这进入的store指令检测的功能？ 3 对于双核的原子指令操作：两个内核之间没有对这原子操作进行通信的功能，这样双核的原子操作功能需要怎样进行实现？ [TRANSLATION] Dcache of Nanhu will not throw an error when executing...