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模块里面有递归的话插件就不能正常工作了

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hhucchenyixiao

Extension causes high cpu load

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- Issue Type: `Performance` - Extension Name: `fpga-support` - Extension Version: `0.2.3` - OS Version: `Darwin x64 21.3.0` - VS Code version: `1.67.0` :warning: Make sure to **attach** this file...

ritaanthem

translate vhdl to vlog

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请问一下，为什么我点击了却没有任何反应呢

shangyanzhao

couldn't read file "*/resources/script/xilinx/launch.tcl": no such file or directory

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在 FPGA Options 中 Launch 时 ，使用了命令 ``` terminal vivado -mode tcl -s c:/Users/XXX/.vscode/extensions/sterben.fpga-support-0.1.21/resources/script/xilinx/launch.tcl -notrace -nolog -nojournal ``` 但是本文件找不到，即报错 ``` couldn't read file "c:/Users/XXX/.vscode/extensions/sterben.fpga-support-0.1.21/resources/script/xilinx/launch.tcl": no such file or directory ```...

bqsgwys

SystemVerilog支持

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请问可以添加与Verilog一样，对SystemVerilog的语法支持嘛

xlsjdjdk

Code refactoring

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Is it possible to refactor a signal/port name present in multiple modules (files: *.v)?

amitkulkarnis

建议在索引文件的时候，支持排除路径

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我们很多工程跟模板工程结构不一样，也不分HW和SW，就用全局解析了，只有一两个文件夹不需要解析

joson1

关闭GUI后报错，无法识别add_file命令

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通过插件创建vivado工程后打开GUI，给工程加了个IP核，关掉工程后抱了一堆错，都是一个类型。报错信息如下： add_file : 无法将“add_file”项识别为 cmdlet、函数、脚本文件或可运行程序的名称。请检查名称的拼写，如果包括路径，请确保路径正确，然后再试一次。 是我没配置好什么嘛？识别不出这个命令

EriccWuu

我注意到目前的插件仅支持Vivado TCL的高亮，却没有自动补全+纠错功能 想请教：这个在Vivado自带的editor中有相关功能吗？能否在VSCode上进行二次开发？

yuxuan-z19

not a hdlFile

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- 生成testben时提示 There is no hdlFile respect to xxx.v - 仿真时提示：not a hdlFile 

chansonZ